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本节翻译
【原文】2.5. CONTROL REGISTERS
The control registers (CR0, CR1, CR2, CR3, and CR4, see Figure 2-5) determine operating mode of the processor and the characteristics of the currently executing task, as described below:
• CR0—Contains system control flags that control operating mode and states of the processor.
• CR1—Reserved.
• CR2—Contains the page-fault linear address(the linear address that caused a page fault).
• CR3—Contains the physical address of the base of the page directory and two flags (PCD and PWT). This register is also known as the page-directory base register (PDBR). Only the 20 most-significant bits of the page-directory base address are specified; the lower 12 bits of the address are assumed to be 0. The page directory must thus be aligned to a page (4-KByte) boundary. The PCD and PWT flags control caching of the page directory in the processor’s internal data caches (they do not control TLB caching of page-Directory information).
When using the physical address extension, the CR3 register contains the base address of the page-directory-pointer table (see Section 3.8., “36-Bit Physical Addressing Using the PAE Paging Mechanism”).
• CR4—Contains a group of flags that enable several architectural extensions, and indicate operating system or executive support for specific processor capabilities.
【翻译】2.5. 控制寄存器
控制寄存器（CR0、CR1、CR2、CR3和CR4，见图2-5）确定处理器的工作模式和当前执行任务的特征，如下所示：
CR0——包含控制处理器工作模式和状态的系统控制标志。
•CR1——保留。
CR2——包含页错误线性地址（导致页错误的线性地址）。
CR3——包含了页目录物理基地址和两个标志（PCD和PWT）。该寄存器也称为页目录基地址寄存器（page-directory base register， PDBR）。只指定了页目录基地址的20个最高有效位。地址的低12位假定为0。因而页目录必须对齐到一个页（4 kb）边界。PCD和PWT标志控制处理器内部数据高速缓存中页目录的高速缓存（它们不控制页目录信息的TLB高速缓存）。
在使用物理地址扩展时，CR3寄存器包含页目录指针表的基址（参见3.8节），“使用PAE分页机制的36位物理寻址”)。
CR4——包含了一组标志，用于启用几个体系结构扩展，指示操作系统或执行机构对特定处理器能力的支持度。
